本研究主要目的為設計並實現一套以FPGA為平台的混沌加密之數位影擷取系統。透過CMOS擷取即時影像後經由FPGA進行混沌加密與解密的動作，最後以PC顯示並驗證其正確性。在影像加密部份，本研究採用邏輯斯諦映射(Logistic map)取代傳統加密技術。在數值運算方面，本研究以Verilog HDL設計了符合IEEE 754的浮點數模組，進行浮點運算以提高結果的精確度。經實際測試後，本文所實現影像加解密模組，能正確地將圖片進行加密與解密。

A FPGA-based image capture system with chaotic encryption is developed in this thesis. The immediate image is captured via the COMS sensor, and then encrypted and decrypted by FPGA module. The Logistic map is employed as the encryption algorithm, which designed by the IEEE 754 floating point module to improve the accuracy of the result. For testing the feasibility of this system, the solutions of encryption and decryption are presented and valided on PC. It has been shown that this system can work effectively for image encryption and decryption operations.

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